Detail publikace

Generátor paketů založený na FPGA

MATOUŠEK, J.

Originální název

Generátor paketů založený na FPGA

Anglický název

FPGA-Based Packet Generator

Typ

článek ve sborníku mimo WoS a Scopus

Jazyk

čeština

Originální abstrakt

Přenosové rychlosti v současných páteřních sítích se pohybují v hodnotách desítek Gb/s. Zařízení pro takové počítačové sítě musejí být řádně testována na plné přenosové rychlosti. Tento požadavek však implikuje potřebu zařízení schopného přehrávat a/nebo generovat síťový provoz touto rychlostí. Tento článek popisuje originální architekturu generátoru paketů pro vysokorychlostní sítě, jenž je založen na platformě NetCOPE a rodině karet COMBOv2. Navrhované zařízení bude implementováno v FPGA čipu a umožní přehrávání a generování síťového provozu na plné rychlosti dvou síťových rozhraní s maximální přenosovou rychlostí 10 Gb/s. Vysílaný síťový provoz bude volitelně možné omezovat na základě přesných 64bitových časových značek. Tato možnost tak uživatelům dovolí provádět časové kritické experimenty vyžadující přesně definované mezipaketové mezery.

Anglický abstrakt

Current backbone networks operate at speed of tens of Gb/s. Devices for these networks have to be tested properly at full wire speed. This implies the need for a testing device able to replay and/or generate network traffic at this speed. This paper describes a novel architecture of a high-speed network packet generator based on the NetCOPE platform and the COMBOv2 card. Proposed device is to be implemented in the FPGA chip and it will allow replaying and generating network traffic at full wire speed of two 10 Gb/s network interfaces. As an optional feature, limiting of transmitted traffic based on precise 64-bit timestamps will be included. This will allow users to perform time-critical experiments requiring precisely defined inter-packet delays.

Klíčová slova v angličtině

packet generator, NetCOPE, COMBOv2, 10 Gigabit Ethernet, timestamp

Autoři

MATOUŠEK, J.

Rok RIV

2011

Vydáno

28. 4. 2011

Nakladatel

Vysoké učení technické v Brně

Místo

Brno

ISBN

978-80-214-4272-6

Kniha

Proceedings of the 17th Conference STUDENT EEICT 2011

Strany od

312

Strany do

314

Strany počet

3

URL

http://www.feec.vutbr.cz/conf/EEICT/archiv/sborniky/EEICT_2011_sbornik/02-Magisterske%20projekty/10-Pocitacove%20systemy/07-xmatou06.pdf

BibTex

@inproceedings{BUT76468,
  author="Jiří {Matoušek}",
  title="Generátor paketů založený na FPGA",
  booktitle="Proceedings of the 17th Conference STUDENT EEICT 2011",
  year="2011",
  pages="312--314",
  publisher="Vysoké učení technické v Brně",
  address="Brno",
  isbn="978-80-214-4272-6",
  url="http://www.feec.vutbr.cz/conf/EEICT/archiv/sborniky/EEICT_2011_sbornik/02-Magisterske%20projekty/10-Pocitacove%20systemy/07-xmatou06.pdf"
}