Detail publikace

Web-Based Simulator of Superscalar RISC-V Processors

JAROŠ, J. MAJER, M. HORKÝ, J. VÁVRA, J.

Originální název

Web-Based Simulator of Superscalar RISC-V Processors

Typ

prezentace, poster

Jazyk

angličtina

Originální abstrakt

Mastering computational architectures is essential for developing fast and power-efficient programs. Our advanced simulator empowers both IT students and professionals to grasp the fundamentals of superscalar processors and HW-SW co-design. With customizable processor architecture, full C compiler support, and detailed performance statistics, this tool offers a comprehensive learning experience. Enjoy the convenience of a modern, web-based GUI to enhance your understanding and skills.

Klíčová slova

Web-based simulator, RISC-V processor, superscalar processor 

Autoři

JAROŠ, J.; MAJER, M.; HORKÝ, J.; VÁVRA, J.

Vydáno

30. 11. 2024

Místo

Atlanta, GA

Strany od

1

Strany do

2

Strany počet

2

URL

https://sc24.supercomputing.org/proceedings/poster/poster_files/post150s2-file3.pdf

BibTex

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Dokumenty

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