Publikace

• 2010

  ŠIMÁČEK, J.; SEKANINA, L.; STAREČEK, L. Evolutionary Design of Reconfiguration Strategies to Reduce the Test Application Time. Evolvable Systems: From Biology to Hardware. Lecture Notes in Computer Science. Berlin: Springer Verlag, 2010. s. 214-225. ISBN: 978-3-642-15322-8.
  Detail | WWW

• 2008

  STAREČEK, L.; SEKANINA, L.; KOTÁSEK, Z. Reduction of Test Vectors Volume by Means of Gate-Level Reconfiguration. Proc. of 2008 IEEE Design and Diagnostics of Electronic Circuits and Systems Workshop. Bratislava: IEEE Computer Society, 2008. s. 255-258. ISBN: 978-1-4244-2276-0.
  Detail | WWW

  SEKANINA, L.; STAREČEK, L.; KOTÁSEK, Z.; GAJDA, Z. Polymorphic Gates in Design and Test of Digital Circuits. International Journal of Unconventional Computing, 2008, roč. 4, č. 2, s. 125-142. ISSN: 1548-7199.
  Detail | WWW

• 2007

  RŮŽIČKA, R.; STAREČEK, L. Development of Building Blocks for Polymorphic Digital Circuits. In Proceedings of the Work in Progress Session of 10th Euromicro DSD 2007. Linz: Johannes Kepler University Linz, 2007. s. 33-34. ISBN: 978-3-902457-16- 5.
  Detail

  STAREČEK, L. Polymorfní hradla pro optimalizaci testu obvodu. In Sborník příspěvků Česko- slovenského semináře Počítačové architektury a diagnostika pro studenty doktorandského studia. Plzeň: Západočeská univerzita v Plzni, 2007. s. 41-46. ISBN: 978-80-7043-605- 9.
  Detail

  STAREČEK, L.; SEKANINA, L.; GAJDA, Z.; KOTÁSEK, Z.; PROKOP, R.; MUSIL, V. On Properties and Utilization of Some Polymorphic Gates. In 6th Electronic Circuits and Systems Conference (ECS 2007). Bratislava: Faculty of Informatics and Information Technology STU, 2007. s. 77-81. ISBN: 978-80-227-2697- 9.
  Detail

• 2006

  SEKANINA, L.; STAREČEK, L.; GAJDA, Z.; KOTÁSEK, Z. Evolution of Multifunctional Combinational Modules Controlled by the Power Supply Voltage. In Proc. of the 1st NASA/ ESA Conference on Adaptive Hardware and Systems. Piscataway: IEEE Computer Society, 2006. s. 186-193. ISBN: 0-7695-2614- 4.
  Detail

  STAREČEK, L. Modelování polymorfních hradel a obvodů. In Sborník příspěvků Česko- slovenského semináře Počítačové architektury a diagnostika pro studenty doktorandského studia. Bratislava: Slovenská akademie věd, 2006. s. 67-72. ISBN: 80-969202-2- 7.
  Detail

  SEKANINA, L.; STAREČEK, L.; KOTÁSEK, Z. Novel Logic Circuits Controlled by Vdd. In Proc. of 2006 IEEE Design and Diagnostics of Electronic Circuits and Systems Workshop. Praha: IEEE Computer Society, 2006. s. 85-86. ISBN: 1424401844.
  Detail

*) Citace publikací se generují jednou za 24 hodin.